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Commit 62b323e2 authored by Alexander Kurz's avatar Alexander Kurz Committed by Greg Ungerer
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m68knommu: fixing compiler warnings 



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parent 745c061f

arch/m68knommu/platform/528x/gpio.c

+105 −105
Original line number Original line Diff line number Diff line
@@ -33,9 +33,9 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 1,

			.base			= 1,

			.ngpio			= 7,

			.ngpio			= 7,

		},

		},

		.pddr				= MCFEPORT_EPDDR,

		.pddr				= (void __iomem *)MCFEPORT_EPDDR,

		.podr				= MCFEPORT_EPDR,

		.podr				= (void __iomem *)MCFEPORT_EPDR,

		.ppdr				= MCFEPORT_EPPDR,

		.ppdr				= (void __iomem *)MCFEPORT_EPPDR,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -49,9 +49,9 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 8,

			.base			= 8,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFGPTA_GPTDDR,

		.pddr				= (void __iomem *)MCFGPTA_GPTDDR,

		.podr				= MCFGPTA_GPTPORT,

		.podr				= (void __iomem *)MCFGPTA_GPTPORT,

		.ppdr				= MCFGPTB_GPTPORT,

		.ppdr				= (void __iomem *)MCFGPTB_GPTPORT,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -65,9 +65,9 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 16,

			.base			= 16,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFGPTB_GPTDDR,

		.pddr				= (void __iomem *)MCFGPTB_GPTDDR,

		.podr				= MCFGPTB_GPTPORT,

		.podr				= (void __iomem *)MCFGPTB_GPTPORT,

		.ppdr				= MCFGPTB_GPTPORT,

		.ppdr				= (void __iomem *)MCFGPTB_GPTPORT,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -81,9 +81,9 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 24,

			.base			= 24,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFQADC_DDRQA,

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		.podr				= MCFQADC_PORTQA,

		.podr				= (void __iomem *)MCFQADC_PORTQA,

		.ppdr				= MCFQADC_PORTQA,

		.ppdr				= (void __iomem *)MCFQADC_PORTQA,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -97,9 +97,9 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 32,

			.base			= 32,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFQADC_DDRQB,

		.pddr				= (void __iomem *)MCFQADC_DDRQB,

		.podr				= MCFQADC_PORTQB,

		.podr				= (void __iomem *)MCFQADC_PORTQB,

		.ppdr				= MCFQADC_PORTQB,

		.ppdr				= (void __iomem *)MCFQADC_PORTQB,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -113,11 +113,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 40,

			.base			= 40,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRA,

		.pddr				= (void __iomem *)MCFGPIO_DDRA,

		.podr				= MCFGPIO_PORTA,

		.podr				= (void __iomem *)MCFGPIO_PORTA,

		.ppdr				= MCFGPIO_PORTAP,

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		.setr				= MCFGPIO_SETA,

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		.clrr				= MCFGPIO_CLRA,

		.clrr				= (void __iomem *)MCFGPIO_CLRA,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -131,11 +131,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 48,

			.base			= 48,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRB,

		.pddr				= (void __iomem *)MCFGPIO_DDRB,

		.podr				= MCFGPIO_PORTB,

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		.ppdr				= MCFGPIO_PORTBP,

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		.setr				= MCFGPIO_SETB,

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		.clrr				= MCFGPIO_CLRB,

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	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -149,11 +149,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 56,

			.base			= 56,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRC,

		.pddr				= (void __iomem *)MCFGPIO_DDRC,

		.podr				= MCFGPIO_PORTC,

		.podr				= (void __iomem *)MCFGPIO_PORTC,

		.ppdr				= MCFGPIO_PORTCP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTCP,

		.setr				= MCFGPIO_SETC,

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		.clrr				= MCFGPIO_CLRC,

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	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -167,11 +167,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 64,

			.base			= 64,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRD,

		.pddr				= (void __iomem *)MCFGPIO_DDRD,

		.podr				= MCFGPIO_PORTD,

		.podr				= (void __iomem *)MCFGPIO_PORTD,

		.ppdr				= MCFGPIO_PORTDP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTDP,

		.setr				= MCFGPIO_SETD,

		.setr				= (void __iomem *)MCFGPIO_SETD,

		.clrr				= MCFGPIO_CLRD,

		.clrr				= (void __iomem *)MCFGPIO_CLRD,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -185,11 +185,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 72,

			.base			= 72,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRE,

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		.podr				= MCFGPIO_PORTE,

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		.ppdr				= MCFGPIO_PORTEP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTEP,

		.setr				= MCFGPIO_SETE,

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		.clrr				= MCFGPIO_CLRE,

		.clrr				= (void __iomem *)MCFGPIO_CLRE,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -203,11 +203,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 80,

			.base			= 80,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRF,

		.pddr				= (void __iomem *)MCFGPIO_DDRF,

		.podr				= MCFGPIO_PORTF,

		.podr				= (void __iomem *)MCFGPIO_PORTF,

		.ppdr				= MCFGPIO_PORTFP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTFP,

		.setr				= MCFGPIO_SETF,

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		.clrr				= MCFGPIO_CLRF,

		.clrr				= (void __iomem *)MCFGPIO_CLRF,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -221,11 +221,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 88,

			.base			= 88,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRG,

		.pddr				= (void __iomem *)MCFGPIO_DDRG,

		.podr				= MCFGPIO_PORTG,

		.podr				= (void __iomem *)MCFGPIO_PORTG,

		.ppdr				= MCFGPIO_PORTGP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTGP,

		.setr				= MCFGPIO_SETG,

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		.clrr				= MCFGPIO_CLRG,

		.clrr				= (void __iomem *)MCFGPIO_CLRG,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -239,11 +239,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 96,

			.base			= 96,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRH,

		.pddr				= (void __iomem *)MCFGPIO_DDRH,

		.podr				= MCFGPIO_PORTH,

		.podr				= (void __iomem *)MCFGPIO_PORTH,

		.ppdr				= MCFGPIO_PORTHP,

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		.setr				= MCFGPIO_SETH,

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		.clrr				= MCFGPIO_CLRH,

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	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -257,11 +257,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 104,

			.base			= 104,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRJ,

		.pddr				= (void __iomem *)MCFGPIO_DDRJ,

		.podr				= MCFGPIO_PORTJ,

		.podr				= (void __iomem *)MCFGPIO_PORTJ,

		.ppdr				= MCFGPIO_PORTJP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTJP,

		.setr				= MCFGPIO_SETJ,

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		.clrr				= MCFGPIO_CLRJ,

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	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -275,11 +275,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 112,

			.base			= 112,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDRDD,

		.pddr				= (void __iomem *)MCFGPIO_DDRDD,

		.podr				= MCFGPIO_PORTDD,

		.podr				= (void __iomem *)MCFGPIO_PORTDD,

		.ppdr				= MCFGPIO_PORTDDP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTDDP,

		.setr				= MCFGPIO_SETDD,

		.setr				= (void __iomem *)MCFGPIO_SETDD,

		.clrr				= MCFGPIO_CLRDD,

		.clrr				= (void __iomem *)MCFGPIO_CLRDD,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -293,11 +293,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 120,

			.base			= 120,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDREH,

		.pddr				= (void __iomem *)MCFGPIO_DDREH,

		.podr				= MCFGPIO_PORTEH,

		.podr				= (void __iomem *)MCFGPIO_PORTEH,

		.ppdr				= MCFGPIO_PORTEHP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTEHP,

		.setr				= MCFGPIO_SETEH,

		.setr				= (void __iomem *)MCFGPIO_SETEH,

		.clrr				= MCFGPIO_CLREH,

		.clrr				= (void __iomem *)MCFGPIO_CLREH,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -311,11 +311,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 128,

			.base			= 128,

			.ngpio			= 8,

			.ngpio			= 8,

		},

		},

		.pddr				= MCFGPIO_DDREL,

		.pddr				= (void __iomem *)MCFGPIO_DDREL,

		.podr				= MCFGPIO_PORTEL,

		.podr				= (void __iomem *)MCFGPIO_PORTEL,

		.ppdr				= MCFGPIO_PORTELP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTELP,

		.setr				= MCFGPIO_SETEL,

		.setr				= (void __iomem *)MCFGPIO_SETEL,

		.clrr				= MCFGPIO_CLREL,

		.clrr				= (void __iomem *)MCFGPIO_CLREL,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -329,11 +329,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 136,

			.base			= 136,

			.ngpio			= 6,

			.ngpio			= 6,

		},

		},

		.pddr				= MCFGPIO_DDRAS,

		.pddr				= (void __iomem *)MCFGPIO_DDRAS,

		.podr				= MCFGPIO_PORTAS,

		.podr				= (void __iomem *)MCFGPIO_PORTAS,

		.ppdr				= MCFGPIO_PORTASP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTASP,

		.setr				= MCFGPIO_SETAS,

		.setr				= (void __iomem *)MCFGPIO_SETAS,

		.clrr				= MCFGPIO_CLRAS,

		.clrr				= (void __iomem *)MCFGPIO_CLRAS,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -347,11 +347,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 144,

			.base			= 144,

			.ngpio			= 7,

			.ngpio			= 7,

		},

		},

		.pddr				= MCFGPIO_DDRQS,

		.pddr				= (void __iomem *)MCFGPIO_DDRQS,

		.podr				= MCFGPIO_PORTQS,

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		.ppdr				= MCFGPIO_PORTQSP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTQSP,

		.setr				= MCFGPIO_SETQS,

		.setr				= (void __iomem *)MCFGPIO_SETQS,

		.clrr				= MCFGPIO_CLRQS,

		.clrr				= (void __iomem *)MCFGPIO_CLRQS,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -365,11 +365,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 152,

			.base			= 152,

			.ngpio			= 6,

			.ngpio			= 6,

		},

		},

		.pddr				= MCFGPIO_DDRSD,

		.pddr				= (void __iomem *)MCFGPIO_DDRSD,

		.podr				= MCFGPIO_PORTSD,

		.podr				= (void __iomem *)MCFGPIO_PORTSD,

		.ppdr				= MCFGPIO_PORTSDP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTSDP,

		.setr				= MCFGPIO_SETSD,

		.setr				= (void __iomem *)MCFGPIO_SETSD,

		.clrr				= MCFGPIO_CLRSD,

		.clrr				= (void __iomem *)MCFGPIO_CLRSD,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -383,11 +383,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 160,

			.base			= 160,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFGPIO_DDRTC,

		.pddr				= (void __iomem *)MCFGPIO_DDRTC,

		.podr				= MCFGPIO_PORTTC,

		.podr				= (void __iomem *)MCFGPIO_PORTTC,

		.ppdr				= MCFGPIO_PORTTCP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTTCP,

		.setr				= MCFGPIO_SETTC,

		.setr				= (void __iomem *)MCFGPIO_SETTC,

		.clrr				= MCFGPIO_CLRTC,

		.clrr				= (void __iomem *)MCFGPIO_CLRTC,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -401,11 +401,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 168,

			.base			= 168,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFGPIO_DDRTD,

		.pddr				= (void __iomem *)MCFGPIO_DDRTD,

		.podr				= MCFGPIO_PORTTD,

		.podr				= (void __iomem *)MCFGPIO_PORTTD,

		.ppdr				= MCFGPIO_PORTTDP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTTDP,

		.setr				= MCFGPIO_SETTD,

		.setr				= (void __iomem *)MCFGPIO_SETTD,

		.clrr				= MCFGPIO_CLRTD,

		.clrr				= (void __iomem *)MCFGPIO_CLRTD,

	},

	},

	{

	{

		.gpio_chip			= {

		.gpio_chip			= {
@@ -419,11 +419,11 @@ static struct mcf_gpio_chip mcf_gpio_chips[] = { 
			.base			= 176,

			.base			= 176,

			.ngpio			= 4,

			.ngpio			= 4,

		},

		},

		.pddr				= MCFGPIO_DDRUA,

		.pddr				= (void __iomem *)MCFGPIO_DDRUA,

		.podr				= MCFGPIO_PORTUA,

		.podr				= (void __iomem *)MCFGPIO_PORTUA,

		.ppdr				= MCFGPIO_PORTUAP,

		.ppdr				= (void __iomem *)MCFGPIO_PORTUAP,

		.setr				= MCFGPIO_SETUA,

		.setr				= (void __iomem *)MCFGPIO_SETUA,

		.clrr				= MCFGPIO_CLRUA,

		.clrr				= (void __iomem *)MCFGPIO_CLRUA,

	},

	},

};

};