Donate to e Foundation | Murena handsets with /e/OS | Own a part of Murena! Learn more

Commit 6e04339f authored by qctecmdr's avatar qctecmdr Committed by Gerrit - the friendly Code Review server
Browse files

Merge "ARM: dts: msm: Update clock handles for PCIE nodes"

parents 86b6196b 327a03e9

qcom/yupik-pcie.dtsi

+4 −2
Original line number Diff line number Diff line
@@ -79,10 +79,11 @@ 
			<&gcc GCC_PCIE_0_SLV_Q2A_AXI_CLK>,

			<&gcc GCC_AGGRE_NOC_PCIE_TBU_CLK>,

			<&gcc GCC_PCIE0_PHY_RCHNG_CLK>,

			<&gcc GCC_AGGRE_NOC_PCIE_CENTER_SF_AXI_CLK>,

			<&gcc GCC_DDRSS_PCIE_SF_CLK>,

			<&gcc GCC_AGGRE_NOC_PCIE_0_AXI_CLK>,

			<&gcc GCC_AGGRE_NOC_PCIE_1_AXI_CLK>,

			<&gcc GCC_PCIE_0_PIPE_CLK_SRC>,

			<&gcc GCC_AGGRE_NOC_PCIE_CENTER_SF_AXI_CLK>,

			<&pcie_0_pipe_clk>;

		clock-names = "pcie_0_pipe_clk", "pcie_0_ref_clk_src",

				"pcie_0_aux_clk", "pcie_0_cfg_ahb_clk",
@@ -92,6 +93,7 @@ 
				"pcie_ddrss_sf_tbu_clk",

				"pcie_aggre_noc_0_axi_clk",

				"pcie_aggre_noc_1_axi_clk", "pcie_pipe_clk_mux",

				"pcie_aggre_noc_south_sf_axi_clk",

				"pcie_pipe_clk_ext_src";

		max-clock-frequency-hz = <0>, <0>, <19200000>, <0>, <0>, <0>,

					<0>, <0>, <0>, <0>, <100000000>, <0>,
@@ -347,7 +349,7 @@ 
			<&gcc GCC_PCIE_1_CFG_AHB_CLK>,

			<&gcc GCC_PCIE_1_MSTR_AXI_CLK>,

			<&gcc GCC_PCIE_1_SLV_AXI_CLK>,

			<&gcc GCC_PCIE_CLKREF_EN>,

			<&rpmhcc RPMH_CXO_CLK>,

			<&gcc GCC_PCIE_1_SLV_Q2A_AXI_CLK>,

			<&gcc GCC_AGGRE_NOC_PCIE_TBU_CLK>,

			<&gcc GCC_PCIE1_PHY_RCHNG_CLK>,